e/Clock skew

Information
has gloss	eng: In circuit design In circuit designs, clock skew (sometimes timing skew) is a phenomenon in synchronous circuits in which the clock signal (sent from the clock circuit) arrives at different components at different times. This can be caused by many different things, such as wire-interconnect length, temperature variations, variation in intermediate devices, capacitive coupling, material imperfections, and differences in input capacitance on the clock inputs of devices using the clock. As the clock rate of a circuit increases, timing becomes more critical and less variation can be tolerated if the circuit is to function properly.
lexicalization	eng: clock skew
instance of	c/Electronics terms

Meaning
Japanese
has gloss	jpn: クロックスキュー（英: Clock skew）とは、クロック同期型の電子回路において、クロック回路から送られるクロック信号が、回路の異なる部分に異なったタイミングで到着する現象である。この現象は、中間経路に存在する回路、容量性カップリング、材料的な欠陥、クロックに対する入力容量などの様々な要因から発生しうる。クロックの周波数が高まると、タイミングはより重要になり、回路の正常動作に許容される到着時間の変動幅は小さくなる。スキューには、負のスキューと正のスキューの二種類がある。正のスキューはクロックがあるレジスタが別のレジスタに対してデータを送る際、受信側より先に送信側にクロックが到着するケースで、負のスキューはその逆である。
lexicalization	jpn: クロックスキュー
Castilian
has gloss	spa: Sesgo de reloj hace referencia a la desviación (sesgo) producida en mecanismos de medida del tiempo. El concepto se usa en electrónica y en informática.
lexicalization	spa: Sesgo de reloj